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http://hdl.handle.net/11422/22824| Especie: | Trabalho de conclusão de graduação |
| Título : | O processador Sapiens16: uma variante da arquitetura Sapiens para 16 bits |
| Autor(es)/Inventor(es): | Bruno, Daniel Barbosa |
| Tutor: | Silva, Gabriel Pereira |
| Resumen: | Este trabalho apresenta um simulador adaptado para uma versão modificada do processador Sapiens, projetado para avançar os estudos de arquitetura de computadores. O simulador, junto com a variante do processador, implementa alterações destinadas a melhorar a experiência do usuário, especialmente para aqueles novos no desenvolvimento em linguagem de montagem. Um problema crítico identificado dentro da arquitetura Sapiens foi a falta de correspondência entre as larguras do acumulador e do ponteiro de instrução, dificultando o funcionamento contínuo de ponteiros de 16 bits dentro do acumulador de 8 bits. Para resolver isso, o Sapiens16, a variante desenvolvida neste projeto, soluciona o dilema expandindo a largura do acumulador para 16 bits. O simulador acompanhante, SimuS-16, incorpora recursos que facilitam o monitoramento da simulação, como pontos de interrupção e diversos métodos de visualização de dados de memória. Notavelmente, o SimuS-16 oferece mecanismos aprimorados de feedback de erro durante as fases de montagem e execução do programa. O resultado esperado dessa iniciativa é uma redução significativa na complexidade associada ao desenvolvimento e monitoramento de progresso de programas em linguagem de montagem, especialmente em comparação com seus predecessores. |
| Materia: | Simulador Processador Sapiens SimuS Simulator Sapiens processor |
| Materia CNPq: | CNPQ::CIENCIAS EXATAS E DA TERRA::CIENCIA DA COMPUTACAO |
| Unidade de producción: | Instituto de Computação |
| Editor: | Universidade Federal do Rio de Janeiro |
| Fecha de publicación: | 27-mar-2024 |
| País de edición : | Brasil |
| Idioma de publicación: | por |
| Tipo de acceso : | Acesso Aberto |
| Aparece en las colecciones: | Ciência da Computação |
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