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http://hdl.handle.net/11422/22824
Tipo: | Trabalho de conclusão de graduação |
Título: | O processador Sapiens16: uma variante da arquitetura Sapiens para 16 bits |
Autor(es)/Inventor(es): | Bruno, Daniel Barbosa |
Orientador: | Silva, Gabriel Pereira |
Resumo: | Este trabalho apresenta um simulador adaptado para uma versão modificada do processador Sapiens, projetado para avançar os estudos de arquitetura de computadores. O simulador, junto com a variante do processador, implementa alterações destinadas a melhorar a experiência do usuário, especialmente para aqueles novos no desenvolvimento em linguagem de montagem. Um problema crítico identificado dentro da arquitetura Sapiens foi a falta de correspondência entre as larguras do acumulador e do ponteiro de instrução, dificultando o funcionamento contínuo de ponteiros de 16 bits dentro do acumulador de 8 bits. Para resolver isso, o Sapiens16, a variante desenvolvida neste projeto, soluciona o dilema expandindo a largura do acumulador para 16 bits. O simulador acompanhante, SimuS-16, incorpora recursos que facilitam o monitoramento da simulação, como pontos de interrupção e diversos métodos de visualização de dados de memória. Notavelmente, o SimuS-16 oferece mecanismos aprimorados de feedback de erro durante as fases de montagem e execução do programa. O resultado esperado dessa iniciativa é uma redução significativa na complexidade associada ao desenvolvimento e monitoramento de progresso de programas em linguagem de montagem, especialmente em comparação com seus predecessores. |
Palavras-chave: | Simulador Processador Sapiens SimuS Simulator Sapiens processor |
Assunto CNPq: | CNPQ::CIENCIAS EXATAS E DA TERRA::CIENCIA DA COMPUTACAO |
Unidade produtora: | Instituto de Computação |
Editora: | Universidade Federal do Rio de Janeiro |
Data de publicação: | 27-Mar-2024 |
País de publicação: | Brasil |
Idioma da publicação: | por |
Tipo de acesso: | Acesso Aberto |
Aparece nas coleções: | Ciência da Computação |
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